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ACPL-K71T、ACPL-K72T、ACPL-K74T 和 ACPL-K75T
ACPL-K71T 和 ACPL-K72T 是高速数字 CMOS 光耦合器封装，适用于新兴电动汽车应用。ACPL-K74T 和 ACPL-K75T 分别是 ACPL-K71T 和 ACPL-K72T 的双通道等效产品。所有产品均采用扩展的 SO-8 封装外形，旨在与标准表面贴装工艺兼容。
PACPLAN 太平洋岛屿区域海上溢油应急计划 2019
在一个有时被称为“大洋洲”的地区，海洋的健康对于太平洋岛屿生活的各个方面都至关重要。沿海和海洋环境对太平洋岛民生活的各个方面都至关重要，而海洋溢油的影响是太平洋岛民最关心的问题。由于整个太平洋缺乏主要的陆地屏障，再加上跨洋流的复杂模式，就水流动而言，太平洋可能是地球上连通性最强、连续性最强的海洋。这一特点加剧了该地区海洋污染的严重性。一个地区发生的事件可能会对其他地区产生影响，因为污染物和污染物是通过海洋运动从其来源携带出来的。
ACPL-K49T - 宽温汽车 R
a.逻辑高电平下的共模瞬变抗扰度是共模脉冲 V CM 上升沿上的最大可容忍（正）dV CM /dt，以确保输出将保持在逻辑高状态（即 V O > 2.0V）。逻辑低电平下的共模瞬变抗扰度是共模脉冲信号 V CM 下降沿上的最大可容忍（负）dV CM /dt，以确保输出将保持在逻辑低状态（即 V O < 0.8V）。
ACPL-M43T：带 R2Coupler 隔离和 5 针 SMT 封装的宽工作温度汽车数字光耦合器数据表
注释：1.电流传输比（百分比）定义为输出集电极电流 I O 与正向 LED 输入电流 I F 之比乘以 100。2.建议使用 0.1 F 旁路电容连接引脚 5 和 8。3.1.9 k 负载代表 1.6 mA 的 1 TTL 单位负载和 5.6 k 上拉电阻。4.对于任何给定设备，脉冲宽度失真 (PWD) 定义为 |t PHL – t PLH |。5.相同测试条件下任意两个部件之间的 t PLH 和 t PHL 之间的差异。6.逻辑高电平下的共模瞬态抗扰度是共模脉冲 V CM 上升沿上的最大可容忍（正）dV CM /dt，以确保输出将保持在逻辑高状态（即，V O > 2.0 V）。逻辑低电平下的共模瞬态抗扰度是共模脉冲信号 V CM 下降沿上的最大可容忍（负）dV CM /dt，以确保输出将保持在逻辑低状态（即，V O < 0.8 V）。7.设备被视为双端设备：引脚 1、2、3 和 4 短接在一起，引脚 5、6、7 和 8 短接在一起。8.根据 UL 1577，每个光耦合器都通过施加绝缘测试电压 > 6000 V RMS 持续 1 秒进行验证测试。
ACPL-M43T - 数据表
注释：1. 在自然通风温度 85°C 以上，以 0.25 mA/°C 的速率线性降额。2. 在自然通风温度 85°C 以上，以 0.30 mA/°C 的速率线性降额。3. 在自然通风温度 85°C 以上，以 0.375 mW/°C 的速率线性降额。4. 在自然通风温度 85°C 以上，以 1.875 mW/°C 的速率线性降额。5. 电流传输比（百分比）定义为输出集电极电流 I O 与正向 LED 输入电流 I F 之比乘以 100。6. 器件被视为双端器件：引脚 1 和 3 短接在一起，引脚 4、5 和 6 短接在一起。 7. 根据 UL 1577，每个光耦合器都经过绝缘测试电压 ≥ 4500 V RMS 持续 1 秒的验证测试（泄漏检测
ACPL-M43T-500E - Ciiva
注释：1.电流传输比（百分比）定义为输出集电极电流 I O 与正向 LED 输入电流 I F 之比乘以 100。2.设备被视为双端设备：引脚 1 和 3 短接在一起，引脚 4、5 和 6 短接在一起。3.根据 UL 1577，每个光耦合器都通过施加绝缘测试电压 4800 V RMS 持续 1 秒进行验证测试。4.逻辑高电平下的共模瞬态抗扰度是共模脉冲 V CM 上升沿上的最大可容忍（正）dV CM /dt，以确保输出将保持在逻辑高状态（即，V O > 2.0 V）。逻辑低电平下的共模瞬态抗扰度是共模脉冲信号 V CM 下降沿上的最大可容忍（负）dV CM /dt，以确保输出将保持在逻辑低状态（即，V O < 0.8 V）。5.1.9 k 负载代表 1.6 mA 的 1 TTL 单位负载和 5.6 k 上拉电阻。6.交流输出电压比其中频值低 3 dB 的频率。7.建议使用连接在引脚 4 和 6 之间的 0.1 μF 旁路电容。8.对于任何给定设备，脉冲宽度失真 (PWD) 定义为 |t PHL - t PLH |。9.相同测试条件下任意两个部件之间的 t PLH 和 t PHL 之间的差异。
ACPL-M43T-500E - Ciiva
注释：1. 百分比电流传输比定义为输出集电极电流 IO 与正向 LED 输入电流 IF 之比乘以 100。2. 器件被视为双端器件：引脚 1 和 3 短接在一起，引脚 4、5 和 6 短接在一起。3. 按照 UL 1577，每个光电耦合器都通过施加 4800 V RMS 的绝缘测试电压 1 秒进行验证测试。4. 逻辑高电平下的公共瞬态抗扰度是共模脉冲 V CM 上升沿上的最大可容忍（正）dV CM /dt，以确保输出将保持在逻辑高状态（即 VO > 2.0 V）。逻辑低电平下的共模瞬变抗扰度是共模脉冲信号 V CM 下降沿可容忍的最大（负）dV CM /dt，以确保输出保持在逻辑低状态（即 VO < 0.8 V）。5. 1.9 k 负载代表 1.6 mA 的 1 TTL 单位负载和 5.6 k 上拉电阻。6. 交流输出电压比其中频值低 3 dB 的频率。7. 建议使用连接引脚 4 和 6 之间的 0.1 μF 旁路电容。8. 对于任何给定设备，脉冲宽度失真 (PWD) 定义为 |t PHL - t PLH |。9. 在相同测试条件下，任何两个部件之间的 t PLH 和 t PHL 之间的差值。
ACPL-C797 - 光隔离 Sigma-Delta 调制器 - Farnell
结合卓越的光耦合技术，该调制器可提供高噪声容限和出色的隔离模式瞬变免疫力。ACPL-C797 的最小绝缘距离 (DTI) 为 0.5 毫米，可提供可靠的增强绝缘和高工作绝缘电压，适用于故障安全设计。这种出色的隔离性能优于其他替代方案，包括基于电容或磁耦合且 DTI 在微米范围内的设备。采用拉伸 SO-8 (SSO-8) 封装，与传统电流传感器相比，隔离式 ADC 可提供可靠性、小尺寸、卓越隔离和过热性能，电机驱动设计人员需要以低得多的价格准确测量电流。