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RISC-V AI + IoT 的 Sipeed Maixduino 套件
• CPU： • RISC-V 双核 64 位，带 FPU；400MHz 神经网络处理器 • QVGA@60FPS/VGA@30FPS 图像识别 • 板载 ESP32 模块支持 2.4G 802.11。 b/g/n 和蓝牙 4.2 • Arduino Uno 外形尺寸，Arduino 兼容接口 • 板载全向 I 2 S 数字输出 MEMS 麦克风 • 用于 DVP 摄像头的 24P 0.5mm FPC 连接器 • 8 位 MCU LCD 24P 0.5mm FPC 连接器 • 支持自弹式微型 SD 卡座 • 重置和启动按钮以及 3W DAC+PA 音频输出 • 只需连接 USB Type-C 电缆即可完成下载 • 基于卷积神经网络的机器视觉 • 用于机器听觉的高性能麦克风阵列处理器 • 支持 MaixPy IDE、Arduino IDE、OpenMV IDE 和 PlatformIO IDE • 支持用于深度学习的 Tiny-Yolo、Mobilenet 和 TensorFlow Lite
动脉高血压的起源和风险因素
原发性动脉高血压的发病机理是多因素且高度复杂的，涉及许多独立或相互依存的机制的相互作用。遗传因素，神经激活系统的激活，肥胖和饮食中盐摄入量增加，与这种病理的发展有关。动脉高血压是世界人口的高流行，是心血管疾病的主要危险因素，直接负责高发病率和死亡率。最深入了解纳税人的起源和永久性知识是基本的，它是开发和制度更有指导疗法的指南，旨在减少这种疾病的巨大社会影响。
安全地址的威胁和风险 ...
在所有安全层面上发生并反映，导致权力关系和安全风险与威胁发生变化。这些在所有安全层面上相互重叠的挑战决定了需要做出普遍努力来预测其演变并准备减少其对国家安全的影响。本文的目的也属于同一趋势，因为它是对国际安全趋势的科学方法，旨在确定和分析它们对 2040 年时间范围内罗马尼亚国家安全的影响。此外，这项研究是罗马尼亚国防大学“卡罗尔一世”国防和安全战略研究中心为整个政府在不断快速变化的安全环境中确保国家安全和国防的主动方法做出的贡献的一部分。
超越 RV32I ISA 的 RISC-V 处理器验证
摘要 — RISC-V 处理器的开源架构为设计人员提供了灵活性，使他们能够为各种应用实现架构。然而，同样的优势也使验证过程变得困难，因为必须验证所有变体。拟议的项目将为扩展的 RISC V 架构创建一个验证环境。RISC-V 支持整数乘法和除法的“M”标准扩展以及控制和状态寄存器指令的“Zicsr”标准扩展。上述 ISA 类将使用基于 RV32I ISA 的 DUT 进行测试，并在 DUT 周围使用 UVM 环境来验证 M 和 Zicsr 功能。M 和 Zicsr 类型 ISA 经过验证，功能覆盖率为 95%。创建的 UVM 框架可以重复用于验证其他指令集架构。
加速量子后的RISC-V
摘要 - 在这项工作中，我们提出了超大等级密钥封装（Sike）机制的快速且富有效率的软件硬件实现。我们的软件硬件设计既可以实现软件的灵活性，又可以实现强烈计算硬件计算的有效性能。尤其是，我们的实施利用了以Xilinx FPGA为目标的新的且高度优化的硬件模块，用于添加，乘法和硬件软件控制。与一个小的RISC-V处理器结合，我们可以支持所有四个Sike参数集。在Virtex-7 FPGA上，此实现占3,492片，78个DSP和29 BRAMS，以对Sikep434，Sikep503，Sikep610，Sikep610和Sikep751在14.5、19.2、29.8、29.8和42.7 ms上进行封装和分解。尽管支持了所有四个参数集，但该设计具有文献中所有同级加速器的最佳区域时间产品。
一种基于RISC-V处理器的片上调试新方法
RISC-V孵化于加州大学伯克利分校，是基于精简指令集原理的第五代指令集架构，其应用涉及IOT（物联网）、高性能计算等。现行的指令集架构大多受专利保护，这对小公司是一种打击，限制了处理器产业的发展和创新。RISC-V的开源、免费特性为处理器的发展注入了新的活力。随着处理器面积和频率的增加，软件的开发和调试变得更加复杂，对调试手段的要求也越来越高[1]。良好的调试特性可以帮助软件开发人员快速定位错误，因此调试设计对推广RISC-V处理器的使用非常重要，可以有效促进RISC-V处理器生态的发展。
De-RISC：基于 RISC-V 的完整航天级平台
摘要 —H2020 EIC-FTI De-RISC 项目开发了一个 RISC-V 空间级平台，以共同应对空间领域的一些新兴需求和长期需求，例如：(1) 性能高于市场上的单核和基本多核空间级处理器；(2) 可以访问日益丰富的软件生态系统，而不是坚持使用逐渐衰落的基于 SPARC 和 PowerPC 的生态系统；(3) 不受 Arm 等商业 ISA 施加的出口和许可限制（或大幅减少）；(4) 改进对安全相关实时应用程序设计和验证的支持，(5) 该平台的软件符合要求，硬件设计符合既定的空间工业标准。De-RISC 合作伙伴在项目的最初阶段就建立了平台的不同层。然而，他们最近加强了整合和评估活动。本文介绍了 De-RISC 空间平台，介绍了最新进展，例如实现虚拟化和软件认证、新的 MPSoC 功能以及用例部署和评估，包括与其他商业平台的比较。最后，本文介绍了正在进行的活动，这些活动将在 2022 年 9 月之前在 FPGA 上实现 TRL8 的硬件和完全合格的软件平台。
使用基于 SRAM 的 FPGA 上的动态部分重配置对 TMR 开源 RISC-V 处理器进行故障注入
摘要 — 基于 SRAM 的 FPGA 经常用于太空应用中的关键功能。通常需要在这些 FPGA 中实现软处理器来满足任务要求。开放 ISA RISC-V 允许开发各种开源处理器。与所有基于 SRAM 的 FPGA 数字设计一样，这些软处理器容易受到 SEU 的影响。本文介绍了对一组新推出的开源 RISC-V 处理器的性能和相对 SEU 敏感度的研究。利用动态部分重构，这种新颖的自动测试设备可以快速部署不同的实现并通过故障注入评估 SEU 敏感度。使用 BYU 的新 SpyDrNet 工具，还将细粒度 TMR 应用于每个处理器，结果显示敏感度降低了 20 倍到 500 倍。
潜望镜视图
大家好，本月开始有一些悲伤的消息。分会成员、前分会主席兼名誉神父艾伦·琼斯于 2021 年 6 月 24 日在 Risedale 休养院以 80 岁高龄“逝世”。葬礼将于 7 月 12 日星期一 11:30 在 Abbey Road 的三一教堂举行。分会成员将出席，但进入教堂的人数仅限受邀者。除了担任我们的主席和神父外，艾伦还积极参与了我们在拉姆斯登广场的澳大利亚潜艇纪念馆的规划和建立。艾伦是阿斯坎学校的忠实支持者，他在那里多次主持集会，还帮助他们的一些低年级学生学习 IT 技能。艾伦将被所有人和他的许多卫理公会牧师朋友深深怀念。琼·科尔（我们已故分会成员比尔·科尔的妻子）一直与我们保持联系。我们的一些老成员会记得，比尔是分会委员会的成员，参与了 2001 年在巴罗举行的潜艇 100 周年庆典的策划。他也是潜艇遗产中心规划和潜艇绘画收藏品制作的领军人物。琼将在
在超低功率嵌入RISC-V处理器上进行癫痫发作检测
摘要：通过闭环植入式设备对难治性癫痫的处理，这些设备对通过药物释放或电刺激作用的癫痫发作是一种极具吸引力的选择。对于这种可植入的医疗设备，有效和低能消耗，小规模和有效的加工体系结构至关重要。为了满足这些要求，通过卷积神经网络（CNN）对大脑信号进行分析和分类进行癫痫发作检测是一种有吸引力的方法。这项工作为CNN提供了用于在超低功率微处理器上运行的癫痫发作检测。在MATLAB中实现并优化了CNN。此外，在具有RISC-V架构的GAP8微处理器上还实施了CNN。提出的CNN的培训，优化和评估基于CHB-MIT数据集。CNN达到的中位灵敏度为90％，高度高99％以上，对应于中位误报率为每小时6.8 s。在微控制器上实施CNN后，达到了85％的灵敏度。1 s的脑电图数据的分类为t = 35 ms，平均功率为p≈140µW。拟议的检测器在功耗方面优于相关的方法6。通过记录癫痫大鼠，对所提出的基于CNN的检测器的普遍适用性进行了验证。这结果使未来的医疗设备用于癫痫治疗。