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SystemC 中的时间断言
在本文中，我们提出了 SystemC 语言中的时序断言。时序断言旨在用于对具有指定延迟的设计属性进行高级验证。这些断言看起来类似于时序 SystemVerilog 断言 (SVA)。每个时序断言都有前置条件表达式、时间参数、后置条件表达式和断言评估时的事件。每次发生事件时，如果前置条件在过去某个时间点为真（由时间参数指定），则检查后置条件是否为真。如果前置条件为真，但后置条件为假，则违反断言并报告错误。断言事件通常是时钟正沿、负沿或两个沿，因此我们可以在断言评估时考虑一个周期。时间参数用此类周期（发生的事件）的确切数量或范围表示。
ESA IP 核技术要求
本文件的目的是描述技术要求和预期的最低交付成果集，以便允许将设计重新用作可合成的数字 IP 核“知识产权核”或软 IP 核，在 RTL 级别描述。这些要求也可以应用于以适当的建模语言（如 SystemC/TLM）描述的指定功能（如指令和数据处理器、存储器、总线等）的高抽象 IP 模型。本文件中使用术语 IP 核来指代 RTL IP 核和 IP 模型。要求列表组织如下：首先提供适用于 RTL IP 核和 IP 核模型的通用要求列表。然后阐述 RTL IP 核和 IP 模型的具体要求，特别是用 SystemC/TLM 编写的。
COE838 片上系统设计
• 课程大纲 http://www.ee.ryerson.ca/undergraduate/dcd/coe838.html http://www.ee.ryerson.ca/~courses/coe838/ • 要获得的关键知识：片上系统 (SoC) 架构和 SoC IP 核（ARM Cortex、Nios-II 和其他核）、SoC 建模和硬件/软件协同规范、硬件软件协同综合和 SoC 的架构探索、片上网络和片上互连结构（如 AMBA、Avalon）、使用可编程芯片上的系统进行 SoC 原型设计、多核架构和嵌入式片上系统、真实 SoC 及其应用的案例研究。 • 需要掌握的关键技能基于 SystemC 的片上系统仿真和软硬件协同规范、片上系统原型设计的 CAD 工具、实验室和课程项目均采用 Quartus-II 和 SOPC（可编程芯片系统）构建工具。 • 潜在职业 ASIC 设计师、嵌入式系统设计工程师、计算机系统工程师、系统集成工程师、SoC 设计工程师、嵌入式系统测试工程师…… • 潜在雇主 Advanced Micro Devices、DALSA、加拿大原子能公司（AECL）、PMC-Sierra、Research-in-Motion、ST Microelectronics、IBM Canada…… • 研究生学习瑞尔森大学、多伦多大学、滑铁卢大学、UBC、麦吉尔大学、卡尔加里大学、艾伯塔大学等拥有强大的 SoC 设计、嵌入式系统、微系统和先进计算机架构研究生课程。
使用 SoCMake 的硬件和软件构建流程
随着电子产品需求的不断增长，新型专用集成电路 (ASIC) 设计的开发周期也越来越短。为了满足这些较短的设计周期，硬件设计人员在设计中应用了 IP 模块的可重用性和模块化原则。带有集成处理器和通用互连的标准片上系统 (SoC) 架构大大减少了设计和验证工作量，并允许跨项目重复使用。然而，这带来了额外的复杂性，因为 ASIC 的验证还包括在集成处理器上执行的软件。为了提高可重用性，硬件 IP 模块通常用更高抽象级别的语言（例如 Chisel、System-RDL）编写。这些模块依靠编译器（类似于软件编译器）来生成 RTL 仿真和实现工具可读的 Verilog 源文件。此外，在系统级，可以使用 C++ 和 SystemC 对 SoC 进行建模和验证，这进一步凸显了软件编译的重要性。这些要求导致需要一个支持典型硬件流程和工具以及 C++、C 和汇编语言的软件编译和交叉编译的构建系统。现有的硬件构建系统被发现存在不足（见 II），特别是对软件编译（即 C++、C 和汇编语言）的支持极少甚至没有。因此，CERN 的微电子部门启动了一个名为 SoCMake [1] 的新构建系统的开发。SoCMake 最初是作为片上系统抗辐射生态系统 (SOCRATES) [14] 的一部分开发的，该系统可自动生成用于高能物理环境的基于 RISC-V 的容错 SoC，后来发展成为用于 SoC 生成的通用开源构建工具。