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Versal AI 核心
摘要 — 随着深度学习算法的进步超越硬件的进步，您如何确保未来的算法能够很好地适应正在开发的现有 AI 芯片？大多数 AI 芯片都是为当今的 AI 算法设计的，鉴于算法演进的速度和规模，许多 AI 芯片设计甚至在商业发布之前就可能过时。未来的算法需要彻底改革架构、内存/数据资源和功能。理想的推理架构必须重新定义一些基本的芯片技术，这些技术将重写计算规则，并提供突破性的 AI 加速和灵活的计算能力，超越服务器级 CPU，比 GPU/ASIC 更灵活，以支持广泛的应用程序和动态工作负载。本文将讨论如何使用 Xilinx VERSAL AI Core（业界首款 ACAP（自适应计算加速平台）设备，超越 CPU/GPU 和 FPGA 的性能）在硬件和软件设计的各个层面解决这些行业挑战。
Versal™ AI Edge 系列
本文所含信息仅供参考，如有更改，恕不另行通知。尽管在编写本文档时已采取一切预防措施，但其中可能包含技术上的不准确之处、遗漏之处和印刷错误，AMD 没有义务更新或以其他方式更正此信息。Advanced Micro Devices, Inc. 对本文档内容的准确性或完整性不作任何陈述或保证，并且不承担任何责任，包括对本文所述 AMD 硬件、软件或其他产品的操作或使用不侵权、适销性或适用性的默示保证。本文档不授予任何知识产权许可，包括默示许可或禁止反言许可。购买或使用 AMD 产品的条款和限制规定在双方签署的协议或 AMD 的标准销售条款和条件中。
Versal™ AI Edge 系列
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Versal 的 AI 引擎开发
v4cacc48 acc; sbuff = upd_w (sbuff, 0, window_readincr_v8 (w_input)); sbuff = upd_w (sbuff, 1, window_readincr_v8 (w_input)); sbuff = upd_w (sbuff, 2, window_read_v8 (w_input) ); acc = mul4_sym ( sbuff , 0 , 0x3210 , 1 , 15 , coeffs, 0, 0x0000, 1 ); acc = mac4_sym (acc, sbuff , 4 , 0x3210 , 1 , 11 , coeffs, 4, 0x0000, 1 ); window_writeincr (w_output, srs (acc,SRS_SHIFT));
配备 AI 引擎的 Versal™ Premium 系列
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适用于太空 2.0 应用的 XQR Versal™
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xqr versal for Space 2.0应用程序
©版权所有2022 Advanced Micro Devices，Inc。保留所有权利。xilinx，Xilinx徽标，AMD，AMD箭头徽标，Alveo，Alveo，Artix，Kintex，Kira，Kria，Kria，Spartan，Spartan，Versal，Vitis，Vitis，Vivity，VivaDo，Vivado，Zynq，Zynq和其他指定的品牌以及此处包括的其他指定品牌是该产品的其他产品的商标，仅在此类产品中使用了其他产品名称。Amba，Amba设计师，ARM，ARM1176JZ-S，Coresight，Cortex和Primecell是欧盟和其他国家 /地区的ARM商标。PCIE和PCI Express是PCI-SIG的商标，并在许可下使用。在美国印刷AC03-9-22
采用 Versal™ AI Core 系列的 5G 波束成形
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利用 Versal™ AI Core 系列进行 AI 推理
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