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CALIB_IO、波形和时钟生成的 FPGA 实现
摘要 颜色分选机通过传感器检查谷物，并利用颜色差异通过短时间的压缩空气脉冲去除污染物。谷物分选机在碾米行业中已成功使用多年。颜色分选机用于谷物清洁，以去除灰尘颗粒、黑尖、烧焦、其他变色谷物和其他内部污染物等不需要的材料。当今先进的颜色传感器坚固、紧凑、维护成本低且能耗极低。因此，这些颜色传感器可以考虑纳入任何现代谷物清洁厂。本文旨在为谷物分选机开发 Calib_IO、波形生成和时钟生成模块，以去除灰尘颗粒、黑尖、烧焦、其他变色谷物和其他内部污染物等不需要的材料，并提高其处理速度。时钟生成模块是使用 Quartus II 软件设计的，并在 Cyclone IV E（FPGA KIT）中实现，其中包含用于谷物分选的紧凑型颜色传感器。关键词：谷物分选、颜色分选机、Calib_IO、波形生成、时钟生成
远程神经网络的FPGA加速度
曾经假定需要完全精确的计算以获得深入NNS（DNN）的准确结果。最近，研究人员确定了这些模型的较低精度，量化甚至三元或二进制变体可以使用计算资源的一部分来达到适当的精度水平。这些量化的NN（QNN）现在可以使用较低的功率，最小资源，嵌入式芯片（SOC）和FPGA进行实施。sec。3捕获了核心的学习，差距和机会，从QNN文献中进行了进一步的创新。使用卷积NNS（CNN）实施的模式识别算法非常适合太空探索和无人驾驶飞机，并且可以使用这些应用程序使用来基于捕获的图像来识别和分类对象[2]。由于其低成本，低功率消耗和灵活性，FPGA提供了有效实施NNS
主题作者 AI 初创公司 FPGA 软件
________________________________________________________________________________________________________________________________ www.tipalo.com 2021 年 5 月 9 日 Tipalo GmbH，瑞士 第 10 / 22 页
UG0443 用户指南 SmartFusion2 和 IGLOO2 FPGA...
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开放式 FPGA 堆栈 (OFS) 板目录
Altera 和英特尔合作伙伴联盟 (IPA) 合作伙伴提供支持 Open FPGA Stack (OFS) 的平台，用于开发和部署。这些基于 Stratix® 10 和 Agilex™ FPGA 的平台使您能够更快地构建基于 OFS 的软件和应用程序，而无需大量硬件开发或专业知识。许多相同的平台还支持 oneAPI，为应用程序开发提供了更大的灵活性。本季度更新目录旨在列出所有当前可用的平台。您可以在 market.intel.com 上找到有关这些平台的更多详细信息和资料以及联系 IPA 合作伙伴的信息。
CRYSTALS-Kyber 的 FPGA 实现的相关电磁分析
摘要 — 后量子密码学代表了一类抵抗量子算法的密码系统。此类方案在 NIST 标准化过程中受到数学安全性的严格审查，但它们在算法级别上并不安全。这就是为什么研究界必须评估它们的侧信道漏洞。在本文中，我们针对标准密钥封装机制 CRYSTALS-Kyber 的 FPGA 实现进行了非分析相关电磁分析。攻击将多项式乘法执行的电磁辐射模型与捕获的轨迹相关联。通过 166,620 条轨迹，此攻击正确恢复了 100% 的子密钥。此外，还提出了一种对策，以确保目标实现免受所提出的攻击。
基于干涉视觉导航 (iVisNav) 的 FPGA 框架
摘要 — 干涉视觉导航 (iVisNav) 是一种用于自主近距离操作的新型光电传感器。iVisNav 采用激光发射结构化信标，通过测量发射激光脉冲相位的变化来精确表征六个自由度相对运动速率。iVisNav 的嵌入式包必须有效处理高频动态，以实现稳健的传感和估计。本文开发了一种基于最小二乘的速率估计新嵌入式系统。由此产生的系统能够与光子学接口并在现场可编程门阵列中实现估计算法。嵌入式包被证明是一种硬件/软件协同设计，使用有限精度算法进行高速计算来处理估计程序。将有限精度 FPGA 硬件设计的精度与 MATLAB 上算法的浮点软件评估进行比较，以对其性能和与误差测量的统计一致性进行基准测试。实施结果证明了 FPGA 计算能力在使用 iVisNav 进行高速近距离导航方面的实用性。索引术语 — 干涉测量法、状态估计、最小二乘法、FPGA
RT PolarFire FPGA 编程用户指南
如果启用了 Back Level 保护，则 Back Level 版本必须低于正在编程的设计版本。有关这些字段的更多信息，请单击帮助。Back Level 版本值限制了设备接受作为更新的设计版本。只有设计版本严格高于设备中先前存储的当前 Back Level 版本的（新）编程比特流才允许进行编程。Back Level 保护由 FlashLock/UPK1 保护，可以绕过。可以在配置编程选项工具中修改 Back Level 版本和设计版本。有关 sNVM 和安全设置的更多信息，请参阅 PolarFire FPGA 和 PolarFire SoC FPGA 安全用户指南。
适用于 FPGA 平台的 Hex Itoh-Tsujii 逆算法
摘要 Itoh-Tsujii 逆算法在椭圆曲线密码等密码应用中寻找逆元方面做出了重要贡献。本文提出了一种新的 Hex Itoh-Tsujii 逆算法，用于在现场可编程门阵列 (FPGA) 平台上高效计算由 NIST 推荐的不可约三项式生成的二进制域的乘法逆元。基于 Hex Itoh Tsujii 逆算法的所提架构由十六进制电路和四重加法链构成。这种组合提高了资源利用率。实验结果表明，与现有实现相比，所提出的工作具有更好的面积时间性能。关键词：现场可编程门阵列 (FPGA)、Itoh-Tsujii 逆算法 (ITA)、查找表 (LUT)、有限域 (FF) 分类：集成电路（存储器、逻辑、模拟、射频、传感器）
FPGA配置合金相关的分支预测器
说明管道是改善处理器速度的最杰出技术之一；尽管如此，这些管道的阶段仍在不断面对由嵌套条件分支引起的摊位。在执行嵌套条件分支的过程中，跑步分支的行为取决于先前的历史记录信息；因此，这些分支在降低条件分支之间分支预测因子的预测准确性方面具有最大的影响。这项研究的目的是通过引入结合本地和全球预测技术的分支预测变量的硬件模型来减少由相关分支引起的失速周期。此预测因子将合金预测变量的预测特性与相关预测指标的预测特性相结合。在VHDL中实现的预测器设计（非常高速IC硬件说明语言）已插入先前设计的MIPS（无连锁管道管道式阶段的微处理器）中，并通过使用选择排序的算法来确认程序的预测准确性，以将不同组合的100个不同组合的输入数量分类。