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当板载时钟锁定到输入频率时，锁定指示位被设置，并且可以通过 L3 总线或 I 2 C 总线接口读取。在内部，PLL 锁定指示可以与输入数据流的 PCM 状态位以及是否检测到任何突发前导的状态相结合。默认情况下，当 IEC 60958 解码器和板载时钟都锁定到输入信号并且输入数据流是 PCM 数据时，将断言引脚 LOCK。但是，当 IC 被锁定但 PCM 状态位报告非 PCM 数据时，引脚 LOCK 将返回到低电平。锁定状态和 PCM 检测的这种组合可以被 L3 总线或 I 2 C 总线寄存器设置否决。
UDA1352TS 48 kHz IEC 60958 音频 DAC
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