本文报道了对具有 STI 结构的硅基分裂栅 n 沟道 LDMOS 晶体管中热载流子引起的退化机制的联合实验和模拟分析。在这种情况下,电子可以获得足够的动能来在硅/氧化物界面处产生带电陷阱,从而引起器件退化并导致器件电参数发生变化。特别地,已经通过实验在室温下表征了线性状态下的导通电阻退化。通过使用旨在重现退化动力学的物理模型,在 TCAD 模拟框架内重现了热载流子退化。研究了不同应力条件下的电子分布函数及其对分裂栅偏压的依赖性,从而定量了解了热电子在被测器件热载流子退化机制中所起的作用。
注:1. 数据是通过安装在 1 英寸 2 FR-4 板上(2OZ 铜厚)进行测试的 2. 数据是通过安装在建议的最小 FR-4 板上进行测试的 3. 数据是通过脉冲测试的,脉冲宽度≤300μs,占空比≤2% 4. 由设计保证,不受生产影响
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散热器。3.VDMOSFET 是对静电敏感的器件,使用时必须保护器件免受静电损坏。4.本出版物由华晶微电子制作,如有定期更改,恕不另行通知。
暗淡。毫米最小值姓名。最大限度。 A 0.90 1.00 1.10 b 0.31 0.41 0.51 c 0.20 0.25 0.30 D 5.00 5.20 5.40 D1 4.95 5.05 5.15 D2 4.00 4.10 4.20 E2 5.5 5.5 E .60 5.70 E2 3.42 3.53 3.63 e 1.27BSC H 0.60 0.70 0.80 L 0.50 0.70 0.80 K 1.23 REF
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