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但是,该技术具有明显的限制,因为单个组件的失败将禁用整个数据链。为了自动断开前端卡的故障并重组数据传输通道以最大程度地减少数据丢失。对原始FEC设计进行了修改,以实现数据链重建功能。新设计的FEC使用基于FPGA(SF)的SDRAM和基于反将的FPGA(AF),它们执行了处理数字数据所需的所有逻辑功能。图2显示了FEC的实现草图。图3显示数据处理逻辑的一般操作图。
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