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Mercury 的处理模块利用我们的 EchoCore® FPGA IP，使客户能够专注于他们的应用，同时在基础工作的基础上提供开箱即用的基本基础设施功能。Mercury 促进了 FPGA 之间通用 IP 的重复使用，以优化上市时间并缩短开发时间。Mercury 通过使用 AXI4-Lite 连接提供标准控制平面接口来简化应用集成，并使用 AXI4-Stream 交换机在 FPGA 内和外部接口（如 PCIe）路由数据。客户可以使用他们选择的设计工具（如可参数化的 Xilinx IP、HLS 或 RTL）来生成信号处理算法。然后将内核实例化为保留的用户块并编译到 FPGA 中。
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